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わかるVerilog HDL入門―文法の基礎から論理回路設計、論理合成、実装まで (トランジスタ技術SPECIAL)
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著者略歴 (「BOOK著者紹介情報」より) 木村/真也 1977年函館工業高等専門学校電気工学科卒業。1982年豊橋技術科学大学大学院修士課程情報工学専攻修了。1982年日本電気(株)入社。同社にてVシリーズ・マイクロプロセッサ(V20,V30,V33,V60,V70,V80)の開発に従事。1988年より群馬工業高等専門学校電子情報工学科勤務(本データはこの書籍が刊行された当時に掲載されていたものです)
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書名 : わかるVerilog HDL入門―文法の基礎から論理回路設計、論理合成、実装まで (トランジスタ技術SPECIAL)
作者 : 木村 真也
ISBN-10 : 4789837564
発売日 : 2007/2/1
カテゴリー : 本
ファイル名 : わかるverilog-hdl入門-文法の基礎から論理回路設計-論理合成-実装まで-トランジスタ技術special.pdf
ファイルサイズ : 27.76 (現在のサーバー速度は23.38 Mbpsです
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